<?xml version="1.0" encoding="UTF-8" standalone="no"?> <project source="2.7.1" version="1.0"> This file is intended to be loaded by Logisim (http://www.cburch.com/logisim/). <lib desc="#Wiring" name="0"> <tool name="Splitter"> <a name="facing" val="north"/> <a name="fanout" val="8"/> <a name="incoming" val="8"/> <a name="appear" val="legacy"/> </tool> <tool name="Pin"> <a name="facing" val="south"/> </tool> </lib> <lib desc="#Gates" name="1"/> <lib desc="#Plexers" name="2"/> <lib desc="#Arithmetic" name="3"/> <lib desc="#Memory" name="4"> <tool name="ROM"> <a name="contents">addr/data: 8 8 0 </a> </tool> </lib> <lib desc="#I/O" name="5"/> <lib desc="#Base" name="6"> <tool name="Text Tool"> <a name="text" val=""/> <a name="font" val="SansSerif plain 12"/> <a name="halign" val="center"/> <a name="valign" val="base"/> </tool> </lib> <main name="main"/> <options> <a name="gateUndefined" val="ignore"/> <a name="simlimit" val="1000"/> <a name="simrand" val="0"/> </options> <mappings> <tool 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